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Verilog_Louis
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75d1ff029b7b88f3635e4208d60922b47171d28e
Verilog_Louis
/
Semaine_4
/
UART_FIFO
/
IP
/
verilog
History
Gamenight77
e124c7c0c4
Bloquer a cause du tx
2025-05-13 12:22:50 +02:00
..
fifo.v
Bloquer a cause du tx
2025-05-13 12:22:50 +02:00
other_rx.v
rx fifo et tx fifo on l'air de fonctionner lors des testbenchs
2025-05-06 10:59:08 +02:00
other_tx.v
rx fifo et tx fifo on l'air de fonctionner lors des testbenchs
2025-05-06 10:59:08 +02:00
rxuartlite.v
Loopback fifo fonctionne mais avec 3 valeur de décalage
2025-05-09 11:39:40 +02:00
txuartlite.v
Bloquer a cause du tx
2025-05-13 12:22:50 +02:00
uart_rx.v
rx fifo et tx fifo on l'air de fonctionner lors des testbenchs
2025-05-06 10:59:08 +02:00
uart_tx.v
rx fifo et tx fifo on l'air de fonctionner lors des testbenchs
2025-05-06 10:59:08 +02:00