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Verilog_Louis
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cca81f4db51ea80fbff0d3bce9b7f8ec2f437a41
Verilog_Louis
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Semaine_5
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UART_ULTRASON_COMMANDS
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IP
/
verilog
History
Gamenight77
2cb68ce0d1
Debg compliqué
2025-05-12 15:34:02 +02:00
..
fifo.v
ultrasonic commands commencer et tester mais non fonctionnel donc début de testbench pour pouvoir debuguer
2025-05-12 12:15:52 +02:00
rxuartlite.v
ultrasonic commands commencer et tester mais non fonctionnel donc début de testbench pour pouvoir debuguer
2025-05-12 12:15:52 +02:00
uart_rx_fifo.v
ultrasonic commands commencer et tester mais non fonctionnel donc début de testbench pour pouvoir debuguer
2025-05-12 12:15:52 +02:00
uart_tx_fifo.v
ultrasonic commands commencer et tester mais non fonctionnel donc début de testbench pour pouvoir debuguer
2025-05-12 12:15:52 +02:00
uart_tx.v
Loopback fifo fonctionne mais avec 3 valeur de décalage
2025-05-09 11:39:40 +02:00
ultrasonic_fpga.v
Debg compliqué
2025-05-12 15:34:02 +02:00
ultrasonic_sensor.v
ultrasonic commands commencer et tester mais non fonctionnel donc début de testbench pour pouvoir debuguer
2025-05-12 12:15:52 +02:00