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| # Verilog
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| ## Semaine 1
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| ### Jour 1
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| **Matin :**
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| - Exercices HDLbits :
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|   - Vectors
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|   - Modules : hierarchy
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|   - Procedures (commencé)
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| **Après-midi :**
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| - Exercices HDLbits :
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|   - Procedures
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|   - More Verilog features
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|   - Circuits
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| - Début de la mise en place de l’environnement :
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|   - Téléchargement de oss-cad (toolchain) pour simuler et synthétiser le Verilog HDL
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|   - Essais sur des modules Verilog
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| ### Jour 2
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| **Matin :**
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| - Exercices HDLbits :
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|   - Latches & Flip-flops
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| - Lecture de documentation
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| **Après-midi :**
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| - Exercices HDLbits :
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|   - Counters
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| - Difficultés sur la mise en place de l’environnement avec des outils open source :
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|   - Téléchargement et installation du driver open source pour le Tang Nano avec Z-Diag
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| ### Jour 3
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| **Matin :**
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| - Lecture de documentation sur le capteur ultrasonique
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| - Implémentation du fonctionnement du capteur pour tester du code en simulation
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| **Après-midi :**
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| - Implémentation du module de mesure de distance via le capteur
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| - Implémentation du module de conversion distance → affichage sur 6 LEDs (type capteur de recul)
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| - Implémentation du module top combinant les deux modules précédents (système de radar de recul)
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| - Installation du logiciel propriétaire Gowin FPGA
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| - Prise en main du logiciel avec des programmes simples
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| - Premier montage du capteur sur breadboard
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| - Refonte du module de mesure (capteur avec un seul fil bidirectionnel) + mesure continue
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| - Programmation sur FPGA fonctionnelle
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| - Lecture de documentation sur les LEDs WS2812
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| - Implémentation des modules + testbench
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| - Échec
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| ### Jour 4
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| **Matin :**
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| - Lecture de documentation sur le protocole UART (série)
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| - Implémentation :
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|   - `uart_tx` (transmission + encodage) + testbench
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|   - `uart_rx` (réception + décodage) + testbench
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|   - `uart_tx_rx` (communication complète) + testbench
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| - Explication : relier TX du module A au RX du module B et inversement. Pour envoyer des données, inscrire un byte dans `data_in` et donner une impulsion sur `start`. Pour recevoir, attendre que `valid` passe à 1.
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| - Préparation d’un `top-module` pour transmettre la distance mesurée par le capteur au PC via UART
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| **Après-midi :**
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| - Implémentation d’un module combinant capteur + transmission UART pour envoyer la distance au PC
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| - Essai réussi : données envoyées via TX depuis le FPGA, reçues par un script Python
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| - Création d’un module UART bidirectionnel :
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|   - Depuis le PC, on envoie un chiffre entre 0 et 5 → la LED correspondante toggle sur le FPGA
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|   - Le FPGA renvoie l’état actuel
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| - De nombreux bugs
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| - Lecture de code exemple trouvé sur GitHub, résolution partielle des problèmes
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| ### Jour 5
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| - Lecture de code tiers
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| - Essais de différents codes
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| - Réflexion sur la conception du projet final :
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|   - Utilisation d’un ESP32 avec le Tang Nano 20K
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